崗位職責(zé):
負(fù)責(zé)計(jì)算處理、交換傳輸、融合通信、AI算法等領(lǐng)域的產(chǎn)品,底層實(shí)時數(shù)據(jù)并發(fā)處理的核心功能開發(fā),優(yōu)化系統(tǒng)性能等設(shè)計(jì)開發(fā)。
任職要求:
1、計(jì)算機(jī)科學(xué)、軟件工程、電子信息、通信工程、自動化等相關(guān)專業(yè),本科及以上學(xué)歷,985、211學(xué)校優(yōu)先;
2、5年以上通信及計(jì)算產(chǎn)品項(xiàng)目研發(fā)經(jīng)驗(yàn);
3、熟練掌握Verilog或VHDL語言,能夠使用Vivado、ISE、Quartus等EDA工具進(jìn)行開發(fā)?;
4、熟悉網(wǎng)路、DDR、SATA、PCIe、E1、RS232、CAN等接口控制邏輯,掌握FGPA時序約束、資源復(fù)用、布局、布線等技術(shù)。
福利情況:
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備注:優(yōu)秀者可突破月薪范圍,根據(jù)崗位勝任能力面議。