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更新于 4月2日

高級/FPGA工程師

1.8-3萬·13薪
  • 武漢洪山區(qū)
  • 3-5年
  • 本科
  • 全職
  • 招2人

雇員點(diǎn)評標(biāo)簽

  • 工作環(huán)境好
  • 免費(fèi)班車
  • 團(tuán)隊(duì)執(zhí)行強(qiáng)

職位描述

Verilog HDLVHDL高速接口
崗位職責(zé):
1、負(fù)責(zé)基于Xilinx Virtex/Zynq Ultrascale+系列的FPGA開發(fā);
2、主要負(fù)責(zé)基于FPGA的memory器件controller的開發(fā);
3、負(fù)責(zé)產(chǎn)品功能需求分析,配合硬件工程師進(jìn)行器件選型及驗(yàn)證,以及邏輯系統(tǒng)/模塊設(shè)計(jì)、代碼編寫、仿真、調(diào)試和驗(yàn)證;
4、配合軟件工程師進(jìn)行系統(tǒng)調(diào)試,分析、定位、解決問題;
5、根據(jù)公司技術(shù)文檔規(guī)范編寫相應(yīng)的技術(shù)文檔。
任職要求:
1、電子/通信/計(jì)算機(jī)等相關(guān)專業(yè)本科畢業(yè)五年以上,研究生畢業(yè)三年以上;
2、具備較扎實(shí)的數(shù)字電路基礎(chǔ);
3、具備較強(qiáng)的分析處理問題能力,能夠獨(dú)立承擔(dān)開發(fā)一些基本功能單元或產(chǎn)品;
4、熟悉Altera/Xilinx/Lattice等公司相關(guān)器件結(jié)構(gòu);
5、熟練使用Quartus ii/ISE/Vivado/Modelsim/Debussy等EDA工具;
6、Verilog/VHDL/SystemVerilog/SystemC等硬件描述語言至少精通其中一項(xiàng);熟悉C/C++等編程語言;
7、具備良好的編程習(xí)慣及良好的文檔管理習(xí)慣;
8、熟悉DDR/LVDS高速接口標(biāo)準(zhǔn)及相關(guān)協(xié)議;
9、具備良好的溝通能力,較強(qiáng)的團(tuán)隊(duì)配合意識及團(tuán)隊(duì)協(xié)作能力。

工作地點(diǎn)

洪山區(qū)武漢市東湖開發(fā)區(qū)流芳園南路22號

職位發(fā)布者

武漢精測/招聘負(fù)責(zé)人

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公司Logo武漢精測電子集團(tuán)股份有限公司
武漢精測電子集團(tuán)股份有限公司(股票簡稱:精測電子,股票代碼300567.SZ),創(chuàng)立于2006年4月,是一家致力于為半導(dǎo)體、顯示以及新能源等測試領(lǐng)域提供卓越產(chǎn)品和服務(wù)的高新技術(shù)企業(yè)。公司產(chǎn)業(yè)布局日趨完善,在武漢、蘇州、上海、香港、臺灣、美國、日本等地?fù)碛斜姸嗉曳肿庸?。公司成立以來,秉承“品質(zhì)贏得信賴,科技成就未來”的經(jīng)營理念,注重技術(shù)的積累,堅(jiān)持實(shí)施自主創(chuàng)新,以市場需求為導(dǎo)向,緊隨平板顯示產(chǎn)業(yè)發(fā)展趨勢,成功研發(fā)多項(xiàng)平板顯示測試系統(tǒng)。經(jīng)過多年的發(fā)展,公司集合“光、機(jī)、電、軟、算”一體化系統(tǒng)優(yōu)勢,在平板顯示測試領(lǐng)域已處于行業(yè)領(lǐng)先水平,客戶已涵蓋國內(nèi)外各主要面板、模組廠商,技術(shù)與客戶資源優(yōu)勢明顯,為公司的快速持續(xù)發(fā)展提供了充分保障。我們?yōu)閱T工提供:★數(shù)字化學(xué)習(xí)平臺“精測學(xué)院”、“精兵計(jì)劃”等健全的培訓(xùn)制度;★專業(yè)化管理型雙通道發(fā)展模式的晉升途徑;★五險一金、工作餐、班車、年度體檢、豐富的員工活動、生日禮、節(jié)假日購物卡等福利制度。我們的人才理念:★人才導(dǎo)向:尊重人才、塑造人才、成就人才★用人理念:品德+態(tài)度+能力★培育理念:讓普通人成長為優(yōu)秀的人,讓優(yōu)秀的人成長為卓越的人。公司未來將依托在顯示測試領(lǐng)域積累的優(yōu)勢,向半導(dǎo)體、新能源行業(yè)的測試領(lǐng)域滲透,將公司發(fā)展成為“半導(dǎo)體、顯示、新能源行業(yè)以測試設(shè)備為核心的綜合服務(wù)提供商”。
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