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更新于 9月29日

FPGA邏輯設(shè)計(jì)工程師

1-1.6萬
  • 成都雙流區(qū)
  • 3-5年
  • 本科
  • 全職
  • 招1人

職位描述

C語言C++計(jì)算機(jī)軟件儀器儀表制造
崗位職責(zé):
1、負(fù)責(zé)儀控系統(tǒng)設(shè)備及功能模塊邏輯功能(如通信、顯示、信號處理、時(shí)序控制、接口驅(qū)動(dòng)等)的設(shè)計(jì)、實(shí)現(xiàn)及調(diào)試工作,;
2、負(fù)責(zé)FPGA設(shè)計(jì)類文檔編寫工作;
3、負(fù)責(zé)工程項(xiàng)目開展過程中相關(guān)功能的維護(hù)及支持工作,參與問題溝通、分析和定位。
崗位要求:
1、本科及以上學(xué)歷,電子工程、信號處理、通信工程、控制工程、計(jì)算機(jī)等相關(guān)專業(yè);
2、熟練使用VerilogHDL開發(fā)語言,熟練掌握FPGA邏輯設(shè)計(jì)、開發(fā)及調(diào)試流程,熟悉常用FPGAEDA工具,有仿真經(jīng)驗(yàn)者優(yōu)先;
3、熟悉常用傳輸接口,如SPI、I2C、UART等;
4、大學(xué)英語四級及以上,具備良好英文技術(shù)手冊閱讀能力;
5、責(zé)任心強(qiáng),工作認(rèn)真負(fù)責(zé),嚴(yán)謹(jǐn)細(xì)致,具有良好的團(tuán)隊(duì)精神和溝通能力。

工作地點(diǎn)

成都市雙流區(qū)柏順路一段與華府大道三段交叉路口往南約170米

職位發(fā)布者

蒲峒霖/HR

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中國核動(dòng)力研究設(shè)計(jì)院設(shè)計(jì)所
中國核動(dòng)力研究設(shè)計(jì)院核動(dòng)力設(shè)計(jì)研究所(以下簡稱“設(shè)計(jì)所”)是中國核動(dòng)力研究設(shè)計(jì)院下屬的主體設(shè)計(jì)研究所之一。主要承擔(dān)核動(dòng)力裝置和其他各種類型反應(yīng)堆的設(shè)計(jì)開發(fā)與研究工作。
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