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參與從RTL到GDSII的物理實(shí)現(xiàn)流程，重點(diǎn)負(fù)責(zé)UPF低功耗設(shè)計(jì)、DFT Pattern調(diào)試及量產(chǎn)支持，確保芯片滿足功耗、時(shí)序和可測(cè)試性要求。
崗位職責(zé)：
1. RTL到網(wǎng)表物理實(shí)現(xiàn)，參與模塊級(jí)或芯片級(jí)綜合，優(yōu)化時(shí)序、面積和功耗。
2. 低功耗設(shè)計(jì)UPF流程，實(shí)現(xiàn)多電壓域設(shè)計(jì)，定義并驗(yàn)證UPF/CPF低功耗流程；分析功耗并優(yōu)化。
3. DFT Pattern調(diào)試與量產(chǎn)支持，完成Scan/ATPG Pattern生成與驗(yàn)證，調(diào)試測(cè)試覆蓋率問(wèn)題；參與芯片量產(chǎn)問(wèn)題分析，定位DFT相關(guān)測(cè)試失效根因。
4. 流程優(yōu)化與自動(dòng)化，開(kāi)發(fā)TCL/Python腳本提升工作效率，協(xié)助建立和完善中端實(shí)現(xiàn)流程文檔。
任職要求：
1.電子/微電子/計(jì)算機(jī)相關(guān)專業(yè)碩士及以上學(xué)歷，2年以上數(shù)字中端實(shí)現(xiàn)經(jīng)驗(yàn)， 至少參與過(guò)1款芯片的物理實(shí)現(xiàn)。
2.熟悉綜合，STA基礎(chǔ)流程，掌握UPF/CPF低功耗設(shè)計(jì)方法，具備多電壓域設(shè)計(jì)經(jīng)驗(yàn)。
3.了解DFT基礎(chǔ)（Scan/ATPG/MBIST），能調(diào)試測(cè)試Pattern問(wèn)題。
4.能使用TCL/Python進(jìn)行基礎(chǔ)腳本開(kāi)發(fā)。