職位描述
實(shí)習(xí)證明FPGA嵌入式開發(fā)VivadoALTIUM?DESIGNER
崗位職責(zé)：
1.參與并協(xié)助嵌入式硬件系統(tǒng)的方案設(shè)計(jì)與開發(fā)，能夠使用Multisim/Tina/PSpice至少一種仿真軟件進(jìn)行電路暫態(tài)/穩(wěn)態(tài)分析；能夠熟練使用Keil等EDA進(jìn)行嵌入式開發(fā)；
2.熟練掌握制版打板工藝，能夠繪制4層及以上信號(hào)處理PCB；能夠獨(dú)立進(jìn)行焊接和硬件調(diào)試，運(yùn)用邏輯分析儀等定位并解決硬件問(wèn)題；
3.熟悉ADC并行采集方法，能夠進(jìn)行基本的模擬信號(hào)采集電路設(shè)計(jì)與調(diào)試；
了解并使用FPGA硬件架構(gòu)和相關(guān)IP核，熟悉Vivado EDA；了解ARM平臺(tái)AXI總線體系結(jié)構(gòu)，了解基本的時(shí)鐘約束概念，能識(shí)別與避免時(shí)序競(jìng)爭(zhēng)、冒險(xiǎn)等問(wèn)題。
任職條件：
1.26屆在讀優(yōu)先，電子、自動(dòng)化、通信、計(jì)算機(jī)等相關(guān)專業(yè)背景，或具備嵌入式硬件項(xiàng)目經(jīng)驗(yàn)；
2.熟練掌握Altium Designer等相關(guān)軟件，能獨(dú)立完成多層PCB的設(shè)計(jì)與調(diào)試；
3.具備一定的數(shù)字電路和模擬電路基礎(chǔ)，能處理常見硬件故障并提出有效解決方案；
4.掌握Verilog或VHDL語(yǔ)言基礎(chǔ)，了解FPGA的硬件架構(gòu)和IP核使用方法；
5.具備良好的英文閱讀能力，能熟練閱讀datasheet和相關(guān)文獻(xiàn)。
實(shí)習(xí)待遇：
26、27屆本科生120元/天，碩士生180元/天，飯補(bǔ)10元/天；學(xué)生公寓，班車接送，商業(yè)保險(xiǎn)。非26屆待遇另議。
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工作地點(diǎn)
吳興區(qū)湖州南太湖新區(qū)科技創(chuàng)新綜合體
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職位發(fā)布者
王女士/人力資源部
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浙江大學(xué)湖州研究院浙江大學(xué)湖州研究院成立于 2020年 12月，系浙江大學(xué)與湖州市政府共建事業(yè)單位，是集科技研發(fā)、人才引育、企業(yè)孵化、產(chǎn)業(yè)服務(wù)于一體的省級(jí)新型研發(fā)機(jī)構(gòu)。研究院重點(diǎn)以“智能+”為核心，圍繞智能無(wú)人系統(tǒng)、智能感知儀器、智能集成裝備、智能數(shù)字應(yīng)用等領(lǐng)域推進(jìn)創(chuàng)新研究和“產(chǎn)學(xué)研”融合。研究院建有國(guó)家級(jí)博士后科研工作站，智能無(wú)人系統(tǒng)省級(jí)工程研究中心、特種智能倉(cāng)儲(chǔ)物流裝備全省重點(diǎn)實(shí)驗(yàn)室、省級(jí)院士工作站、省僑聯(lián)僑界創(chuàng)新創(chuàng)業(yè)基地、省級(jí)高新技術(shù)產(chǎn)業(yè)高質(zhì)量發(fā)展研究基地，市級(jí)重點(diǎn)實(shí)驗(yàn)室、湖州市產(chǎn)業(yè)培訓(xùn)學(xué)院等平臺(tái)。現(xiàn)有院屬研究中心（項(xiàng)目團(tuán)隊(duì)）28個(gè)，常駐人員 500余人，其中科研人員占 94%以上。孵化科技企業(yè) 38家，其中有 12家入選省級(jí)科技型中小企業(yè)，融速科技、比羿激光、上歐科技等多家企業(yè)與基金方達(dá)成投融資意向，融資額總計(jì) 5000萬(wàn)元。
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