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崗位職責(zé)：
1. 負(fù)責(zé)從電路設(shè)計(jì)到GDSII的完整標(biāo)準(zhǔn)單元庫(kù)開發(fā)流程，包括：邏輯單元、時(shí)序單元、特殊功能單元（如電平轉(zhuǎn)換器、隔離單元、延遲單元等）的設(shè)計(jì)與實(shí)現(xiàn)。
2. 使用行業(yè)主流EDA工具（如CadenceVirtuoso,SynopsysCustom
Compiler、華為九天Aether等）進(jìn)行標(biāo)準(zhǔn)單元的電路圖設(shè)計(jì)、仿真、版圖設(shè)計(jì)與物理驗(yàn)證（DRC/LVS/ERC/ANT）。
3. 為標(biāo)準(zhǔn)單元庫(kù)創(chuàng)建高質(zhì)量的Liberty(.lib)時(shí)序模型、功耗模型及各類標(biāo)準(zhǔn)輸入件（LEF,LIB,
GDS,CDL等）。
4. 對(duì)標(biāo)準(zhǔn)單元進(jìn)行深入的性能、功耗和面積（PPA）分析與優(yōu)化，以滿足不同工藝角（Corner）和電壓下的設(shè)計(jì)需求。
5. 開發(fā)和支持自動(dòng)化腳本（Python/Perl/Tcl等），以提升單元庫(kù)開發(fā)與驗(yàn)證的效率。
6. 與CAD/PDK團(tuán)隊(duì)緊密合作，定義和優(yōu)化單元庫(kù)的開發(fā)流程與方法學(xué)。
7. 為前端設(shè)計(jì)團(tuán)隊(duì)和后端實(shí)現(xiàn)團(tuán)隊(duì)提供技術(shù)支持，解決與標(biāo)準(zhǔn)單元相關(guān)的技術(shù)問題。
任職要求：
1. 本科及以上學(xué)歷，微電子、電子工程、集成電路等相關(guān)專業(yè)。
2. 掌握深亞微米工藝下的CMOS電路設(shè)計(jì)原理，熟悉晶體管的特性與版圖知識(shí)。
3. 熟練使用主流EDA工具，包括：
電路設(shè)計(jì)與仿真：CadenceVirtuoso/Spectre,Synopsys
HSPICE，華為九天Aethe等；
物理驗(yàn)證：SiemensCalibre,SynopsysICValidator、華大九天Argus/Skipper等；
時(shí)序表征：SynopsysSiliconSmart/Primelib,
CadenceLiberate等；
具備良好的腳本編程能力，能使用Python/Tcl/Perl等語言進(jìn)行自動(dòng)化流程開發(fā)。
具備出色的分析問題和解決問題的能力，以及良好的團(tuán)隊(duì)溝通與協(xié)作精神。
優(yōu)先考慮
? 有標(biāo)準(zhǔn)單元庫(kù)或模擬/定制電路設(shè)計(jì)的相關(guān)經(jīng)驗(yàn)。
? 具有7nm及以下先進(jìn)工藝節(jié)點(diǎn)標(biāo)準(zhǔn)單元庫(kù)開發(fā)經(jīng)驗(yàn)。
? 具備豐富的全定制芯片版圖設(shè)計(jì)經(jīng)驗(yàn)，深刻理解版圖對(duì)電路性能的影響。
? 了解數(shù)字后端實(shí)現(xiàn)流程（PnR）及單元庫(kù)在實(shí)現(xiàn)工具中的使用。