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一、核心技能要求
1. 數(shù)學(xué)與算法基礎(chǔ)
- 扎實(shí)的數(shù)學(xué)功底：線性代數(shù)、概率統(tǒng)計(jì)、傅里葉分析、數(shù)字信號(hào)處理（DSP）理論（如濾波/變換/降噪/頻譜分析）。
- 熟悉經(jīng)典算法：FFT、小波變換（Wavelet）、自適應(yīng)濾波（LMS/RLS）、卡爾曼濾波、時(shí)頻分析（STFT）等。

2. 編程與工具
- 熟練使用MATLAB/Python（SciPy/NumPy）進(jìn)行算法仿真與驗(yàn)證。
- 掌握C/C++實(shí)現(xiàn)高性能實(shí)時(shí)信號(hào)處理（嵌入式場(chǎng)景需優(yōu)化計(jì)算效率）。
- 熟悉FPGA的算法移植。

3.工程化能力
- 能將理論算法轉(zhuǎn)化為實(shí)際代碼，考慮實(shí)時(shí)性、內(nèi)存占用和功耗（嵌入式場(chǎng)景）。
- 熟悉信號(hào)處理庫(kù)（如Intel IPP、ARM CMSIS-DSP）或開(kāi)源工具（如GNURadio）。

二、加分項(xiàng)
1. 熟悉機(jī)器學(xué)習(xí)在信號(hào)處理中的應(yīng)用（如CNN/LSTM用于故障診斷）。
2. 有嵌入式Linux或RTOS（如FreeRTOS）開(kāi)發(fā)經(jīng)驗(yàn)，了解DMA/中斷優(yōu)化。
3. 掌握并行計(jì)算（CUDA/OpenCL）或硬件加速（FPGA Verilog/VHDL）。
4. 熟悉傳感器信號(hào)處理（如IMU、毫米波雷達(dá)、光學(xué)傳感器）。

三、軟技能
1. 能閱讀英文論文（如IEEE文獻(xiàn)）并復(fù)現(xiàn)前沿算法。
2. 較強(qiáng)的調(diào)試能力（如使用邏輯分析儀/示波器驗(yàn)證信號(hào)質(zhì)量）。
3. 跨團(tuán)隊(duì)協(xié)作（與硬件工程師、軟件工程師聯(lián)調(diào)）。

四、學(xué)歷及專業(yè)要求
- 本科學(xué)歷及以上，通信專業(yè)優(yōu)先，電子信息相關(guān)相關(guān)專業(yè)均可。
- 工作經(jīng)驗(yàn)1年以上。