職位描述
數(shù)字前端設(shè)計
崗位職責(zé)：
1. 數(shù)字IC前端設(shè)計：使用Verilog/SystemVerilog進(jìn)行RTL代碼設(shè)計、邏輯綜合、靜態(tài)時序分析（STA），優(yōu)化芯片的功耗、性能、面積（PPA）。
2. 特定技術(shù)開發(fā)：可能涉及新型存儲技術(shù)（如ReRAM）的存算一體（CIM）架構(gòu)或存儲控制器設(shè)計。
3. 全流程協(xié)作：與驗證、后端物理實現(xiàn)、測試團(tuán)隊協(xié)作，完成芯片從設(shè)計到樣機(jī)調(diào)試的全過程。
4. 嵌入式開發(fā)：部分職位側(cè)重嵌入式系統(tǒng)開發(fā)，負(fù)責(zé)FPGA/MCU的軟硬件設(shè)計、編碼仿真和調(diào)試。
任職要求：
1. 學(xué)歷專業(yè)：本科以上學(xué)歷，微電子、電子信息、計算機(jī)、自動化等相關(guān)專業(yè)。
2. 核心技能：精通Verilog/SystemVerilog/VHDL，熟悉數(shù)字芯片前端設(shè)計流程和EDA工具（Synopsys/Cadence）。
3. 加分項：熟悉AI算法、AMBA總線、ReRAM技術(shù)；掌握Python/Tcl腳本語言；有FPGA開發(fā)或嵌入式系統(tǒng)開發(fā)經(jīng)驗。
1. 數(shù)字IC前端設(shè)計：使用Verilog/SystemVerilog進(jìn)行RTL代碼設(shè)計、邏輯綜合、靜態(tài)時序分析（STA），優(yōu)化芯片的功耗、性能、面積（PPA）。
2. 特定技術(shù)開發(fā)：可能涉及新型存儲技術(shù)（如ReRAM）的存算一體（CIM）架構(gòu)或存儲控制器設(shè)計。
3. 全流程協(xié)作：與驗證、后端物理實現(xiàn)、測試團(tuán)隊協(xié)作，完成芯片從設(shè)計到樣機(jī)調(diào)試的全過程。
4. 嵌入式開發(fā)：部分職位側(cè)重嵌入式系統(tǒng)開發(fā)，負(fù)責(zé)FPGA/MCU的軟硬件設(shè)計、編碼仿真和調(diào)試。
任職要求：
1. 學(xué)歷專業(yè)：本科以上學(xué)歷，微電子、電子信息、計算機(jī)、自動化等相關(guān)專業(yè)。
2. 核心技能：精通Verilog/SystemVerilog/VHDL，熟悉數(shù)字芯片前端設(shè)計流程和EDA工具（Synopsys/Cadence）。
3. 加分項：熟悉AI算法、AMBA總線、ReRAM技術(shù)；掌握Python/Tcl腳本語言；有FPGA開發(fā)或嵌入式系統(tǒng)開發(fā)經(jīng)驗。
工作地點
成都郫都區(qū)德源街道好醫(yī)生藥業(yè)有限公司藥品生產(chǎn)基地
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