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更新于 6月20日

【校招】邏輯工程師

1-1.6萬·13薪
  • 成都武侯區(qū)
  • 無經(jīng)驗(yàn)
  • 本科
  • 校園
  • 招2人

職位描述

Verilog HDL通信/網(wǎng)絡(luò)設(shè)備電子/半導(dǎo)體/集成電路
崗位職責(zé):
1)負(fù)責(zé)FPGA邏輯需求分解、方案設(shè)計(jì),編寫相關(guān)設(shè)計(jì)文檔、調(diào)測試過程文檔、使用說明文檔;
2)負(fù)責(zé)相控陣天線波束控制算法的FPGA實(shí)現(xiàn);
3)負(fù)責(zé)相控陣天線性能優(yōu)化算法實(shí)現(xiàn)(極化合成算法,交叉極化優(yōu)化算法,擬合等算法等)的FPGA實(shí)現(xiàn);
4)負(fù)責(zé)FPGA代碼編寫,時序、功耗、面積/資源優(yōu)化,保證FPGA最優(yōu)化實(shí)現(xiàn);
5)參與硬件聯(lián)調(diào)及系統(tǒng)聯(lián)合調(diào)試。
任職資格:
1)通信工程、電子信息、自動化等相關(guān)專業(yè),本科及以上學(xué)歷;
2)有FPGA設(shè)計(jì)經(jīng)驗(yàn),熟悉FPGA開發(fā)流程,能使用大規(guī)模邏輯設(shè)計(jì)相關(guān)開發(fā)工具。
3)熟悉跨時鐘域信號處理方法,具備FPGA時序分析及優(yōu)化能力;
4)具有良好的溝通能力和團(tuán)隊(duì)協(xié)作精神。

工作地點(diǎn)

武侯區(qū)成都市高新區(qū)府城大道西段399號天府新谷10棟2106號

職位發(fā)布者

何女士/HRBP

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公司Logo成都天銳星通科技股份有限公司
成都天銳星通科技有限公司致力于成為“普及相控陣技術(shù)的引領(lǐng)者與推動力”。公司成立于2013年,是一家專注于微波、毫米波有源相控陣天線的高新技術(shù)企業(yè),并在南京設(shè)有南京匯君半導(dǎo)體科技有限公司。成都天銳星通專注于有源相控陣天線,毫米波收發(fā)組件、測試設(shè)備的系列化產(chǎn)品研發(fā)及生產(chǎn);南京匯君專注于CMOS射頻芯片設(shè)計(jì)。產(chǎn)品應(yīng)用于寬帶衛(wèi)星通信、5G毫米波通信。公司與東南大學(xué)成立了毫米波芯片技術(shù)聯(lián)合工程研發(fā)中心,與國家實(shí)驗(yàn)室“網(wǎng)絡(luò)通信與安全紫金山實(shí)驗(yàn)室”、深南電路聯(lián)合成立相控陣芯片與系統(tǒng)聯(lián)合實(shí)驗(yàn)室。公司在相控陣技術(shù)領(lǐng)域分別承擔(dān)了2019年、2020年兩項(xiàng)國家重點(diǎn)研發(fā)計(jì)劃,2021年承擔(dān)了國家核高基研發(fā)專項(xiàng)。
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