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更新于 5月29日

高級(jí)固件工程師(J10070)

1.5-3萬(wàn)·16薪
  • 南京雨花臺(tái)區(qū)
  • 5-10年
  • 碩士
  • 全職
  • 招1人

職位描述

Verilog HDL
崗位職責(zé):
1、根據(jù)需求獨(dú)立完成FPGA的需求分析及方案設(shè)計(jì);
2、獨(dú)立完成基于VHDL、Verilog的FPGA設(shè)計(jì);
3、負(fù)責(zé)FPGA的仿真、調(diào)試,配合軟、硬件設(shè)計(jì)人員,完成相關(guān)任務(wù)目標(biāo);
4、參與產(chǎn)品的開發(fā)設(shè)計(jì)、分析解決產(chǎn)品中的問(wèn)題;
5、完成所負(fù)責(zé)產(chǎn)品的技術(shù)開發(fā)文檔編寫維護(hù);
任職要求:
1.電子、自動(dòng)化、儀器、通信等相關(guān)專業(yè),碩士及以上學(xué)歷;
2.5年及以上相關(guān)工作經(jīng)驗(yàn)。
3.熟練使用Verilog 或VHDL語(yǔ)言,精通Xilinx芯片開發(fā)環(huán)境及仿真調(diào)試工具;
4.熟練使用各類片上資源,進(jìn)行資源、性能優(yōu)化、仿真、調(diào)試和時(shí)序收斂,具有良好的代碼風(fēng)格和編程習(xí)慣;
5.具有豐富的 FPGA設(shè)計(jì)開發(fā)和調(diào)試經(jīng)驗(yàn),獨(dú)立完成過(guò)至少100K以上資源復(fù)雜FPGA開發(fā)設(shè)計(jì);
6.有DDR4、高速Serdes、PCIe接口FPGA開發(fā)經(jīng)驗(yàn)優(yōu)先
7.良好的英語(yǔ)口語(yǔ)溝通能力。

工作地點(diǎn)

雨花臺(tái)區(qū)金證南京科技園3棟

職位發(fā)布者

周華先/HR

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公司Logo悅芯科技股份有限公司
悅芯科技成立于2017年2月,專注研發(fā)、生產(chǎn)、銷售各類大規(guī)模集成電路測(cè)試設(shè)備,公司深耕中國(guó),面向全球,為躋身全球優(yōu)秀ATE供應(yīng)商行列、成為國(guó)際知名集成電路測(cè)試方案提供商而竭力前行。公司于2017年開發(fā)的SOC測(cè)試設(shè)備T800和2019年開發(fā)的存儲(chǔ)器測(cè)試設(shè)備TM8000填補(bǔ)了國(guó)產(chǎn)高端集成電路自動(dòng)化測(cè)試設(shè)備領(lǐng)域的空白。2019年,性能達(dá)到行業(yè)先進(jìn)水平的模擬測(cè)試板卡(多路多模)也成功地推向市場(chǎng);公司還會(huì)基于現(xiàn)有SOC測(cè)試系統(tǒng)、Memory測(cè)試系統(tǒng)兩大基礎(chǔ)測(cè)試平臺(tái)陸續(xù)推出CIS測(cè)試系統(tǒng)、SLCT測(cè)試系統(tǒng)等系列化設(shè)備,覆蓋更多芯片產(chǎn)品應(yīng)用市場(chǎng);”為中國(guó)而生,為世界測(cè)試”是悅芯科技成長(zhǎng)前進(jìn)的原動(dòng)力,在技術(shù)研發(fā)方面不斷迭代創(chuàng)新突破,產(chǎn)品質(zhì)量持續(xù)精益求精,服務(wù)模式超值靈活;為廣大集成電路設(shè)計(jì)、生產(chǎn)制造企業(yè),為眾多產(chǎn)品研發(fā)機(jī)構(gòu)、專業(yè)院校等科研單位提供高質(zhì)量、高性能、創(chuàng)新性的集成電路測(cè)試方案。
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