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崗位職責(zé)：
1.參與和完成先進(jìn)工藝高性能IP及常規(guī)Analog/Mixed Signal IP的設(shè)計(jì)；
2.指導(dǎo)layout人員完成IP的版圖設(shè)計(jì)；
3.協(xié)助測(cè)試人員完成各類IP的測(cè)試方案制定，完成性能測(cè)試。
崗位要求：
1.集成電路或微電子、計(jì)算機(jī)相關(guān)專業(yè)本科及以上學(xué)歷；
2.4年以上模擬IP版圖設(shè)計(jì)工作經(jīng)驗(yàn)；希望有數(shù)字標(biāo)準(zhǔn)單元庫(kù)版圖的經(jīng)驗(yàn)
3.能熟練使用主流IC版圖設(shè)計(jì)工具和驗(yàn)證工具，如Virtuoso、Calibre等；能看懂不同F(xiàn)oundry的DRC/LVS rule file以及寄生參數(shù)的抽??；
4.熟悉CMOS logic/MS/RF工藝，PDK的內(nèi)容；
5.熟練掌握集成電路版圖設(shè)計(jì)的相關(guān)技巧和方法（如PCELL的建立、高精度匹配的實(shí)現(xiàn)、高速電路版圖實(shí)現(xiàn)，寄生參數(shù)優(yōu)化、閂鎖預(yù)防和串?dāng)_隔離等）；
6.會(huì)SKILL/Perl/TCL等編程語(yǔ)言優(yōu)先考慮。