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崗位職責(zé)：?1) 驗證流程和驗證方法要求進(jìn)行編碼規(guī)則檢查、功能測試、性能測試、時序測試等，并編寫相應(yīng)的輸出文檔；
2）根據(jù)規(guī)范編寫驗證需求，制定驗證計劃、策略和方案；?3) 負(fù)責(zé)對回歸測試進(jìn)行驗證，并對驗證發(fā)現(xiàn)問題修改情況進(jìn)行追蹤；?4) 負(fù)責(zé)對所參與項目進(jìn)行評審和歸檔工作。
任職要求：
1) 熟悉FPGA產(chǎn)品開發(fā)流程，熟練掌握Verilog/System Verilog編程語言；
2) 熟練使用ISE、Vivado、Libero、Modelsim、Questasim等FPGA開發(fā)驗證工具；
3) 熟悉UVM系統(tǒng)級驗證平臺的搭建、驗證用例的開發(fā)與調(diào)試；
4) 熟悉Shell、Tcl腳本語言，具有后端時序基礎(chǔ)，熟悉靜態(tài)時序驗證方法的優(yōu)先；
5) 通信/集成電路/電子/計算機(jī)/自動化控制相關(guān)專業(yè)，具有通信FPGA開發(fā)或驗證經(jīng)驗優(yōu)先；
6) 具備較強(qiáng)的溝通及需求理解能力。
職位福利：節(jié)日福利、不加班、績效獎金、年終分紅、股票期權(quán)、帶薪年假、彈性工作、員工旅游。